IC芯片設計

IC芯片設計

        IC從生產(chǎn)目的上可以分成為通用IC（如CPU，DRAM，接口芯片等）和ASIC（ApplicationSpecificIntegreted Circuit）兩種，ASIC是因應專(zhuān)門(mén)用途而生產(chǎn)的IC。

       從結構可以分成數字IC，模擬IC，數?；旌螴C三種，而SOC（systemonchip）則成為發(fā)展的方向。從實(shí)現方式上講可以分為三種?；诰w管級，所有器件和互連版圖都采用人工的稱(chēng)為全定制（full-custom）設計，這種方法比較適合于大批量生產(chǎn)的，要求集成度高、速度快、面積小、功耗低的通用型IC或是ASIC?；陂T(mén)陣（Gate-Array）和標準單元（Standard-Cell）的半定制設計（Semi-custom）由于其成本低、周期短、芯片利用率低而適合于批量小、要求推出速度快的芯片?；贗C生產(chǎn)廠(chǎng)家已經(jīng)封裝好的PLD（ProgrammableLogicalDesign）芯片的設計，因為其易用性、“可重寫(xiě)性”受到對集成電路工藝不太了解的系統集成用戶(hù)的歡迎。他的*大特點(diǎn)就是只須懂得硬件描述語(yǔ)言就可以使用特殊EDA工具“寫(xiě)入”芯片功能。但PLD集成度低、速度慢、芯片利用率低的缺點(diǎn)使他只適合新產(chǎn)品的試制和小批量生產(chǎn)。近年來(lái)PLD中發(fā)展*活躍的當屬FPGA(FieldProgrammableGate Array)器件。

       從采用的工藝可以分成雙極型(bipolar)，MOS和其他的特殊工藝。硅（Si）基半導體工藝中的雙極型器件由于功耗大、集成度相對低，在近年隨亞微米深亞微米工藝的的迅速發(fā)展，在速度上對MOS管已不具優(yōu)勢，因而很快被集成度高，功耗低、抗干擾能力強的MOS管所替代。MOS又可分為NMOS、PMOS和CMOS三種；其中CMOS工藝發(fā)展已經(jīng)十分成熟，占據IC市場(chǎng)的絕大部分份額。AsGa器件因為其在高頻領(lǐng)域（可以在0.35um下很輕松作到10GHz）如微波IC中的廣泛應用，其特殊的工藝也得到了深入研究。而應用于視頻采集領(lǐng)域的CCD傳感器雖然也使用IC一樣的平面工藝，但其實(shí)現和標準半導體工藝有很大不同。

       從設計方法可以分成自頂而下（top-down）和自底而上兩種方法。top-down的設計方法在IC開(kāi)發(fā)中,根據不同的項目要求，根據項目經(jīng)費和可供利用的EDA工具和人力資源，根據代工廠(chǎng)的工藝實(shí)際，采用不同的實(shí)現方法是很重要的決策。技術(shù)**和緊跟潮流是IC公司良性循環(huán)的根本保證；
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IC設計中所使用的EDA工具；

       IC設計中EDA工具的日臻完善已經(jīng)使工程師完全擺脫了原先手工操作的蒙昧期。IC設計向來(lái)就是EDA工具和人腦的結合。隨著(zhù)IC不斷向高集成度、高速度、低功耗、高性能發(fā)展，沒(méi)有高可靠性的計算機輔助設計手段，完成設計是不可能的。
       IC設計的EDA工具真正起步于80年代，1983年誕生了**臺工作站平臺apollo;20年的發(fā)展,從硬件描述語(yǔ)言（或是圖形輸入工具）到邏輯仿真工具（LOGICSIMULICATION），從邏輯綜合（logicsynthesis）到自動(dòng)布局布線(xiàn)(autoplane&route)系統；從物理規則檢測(DRC&ERC)和參數提取(LVS)到芯片的*終測試；現代EDA工具幾乎涵蓋了IC設計的方方面面。

       提到IC設計的EDA工具就不能不說(shuō)cadence公司，隨著(zhù)compass的倒閉，它成為這個(gè)行業(yè)名副其實(shí)的“老大”cadence提供了ICdesign中所涉及的幾乎所有工具；但它的工具和它的名氣一樣的值錢(qián)！現代IC技術(shù)的迅猛發(fā)展在EDA軟件廠(chǎng)家中掀起并購、重組熱潮。
除CADENCE公司以外，比較有名的公司包括mentor,avanti,synopsys和INVOEDA；mentor和cadence一樣是一個(gè)在設計的各個(gè)層次都有開(kāi)發(fā)工具的公司，而AVANTI因其模擬仿真工具HSPICE出名，SYNOPSYS則因為邏輯綜合方面的成就而為市場(chǎng)認可。

下面我們根據設計的不同階段和層次來(lái)談?wù)勥@些工具；
（1）輸入工具(designinput)：對自頂而下的（TOP-DOWN）設計方法，往往首先使用VHDL或是VERILOGHDL來(lái)完成器件的功能描述，代表性的語(yǔ)言輸入工具有SUMMIT公司的VISUALHDL和MENTOR公司的RENIOR等。雖然很多的廠(chǎng)家（多為FPGA廠(chǎng)商）都提供自己專(zhuān)用的硬件描述語(yǔ)言輸入，如ALTRA公司的AHDL，但所有的公司都提供了對作為IEEE標準的VHDL，VERILOGHDL的支持。
對自下而上的設計，一般從晶體管或基本門(mén)的圖形輸入開(kāi)始，這樣的工具代表性的有cadence公司的composer;viewlogic公司的viewdraw等，均可根據不同的廠(chǎng)家庫而生成和輸入晶體管或門(mén)電路相對應的模擬網(wǎng)表。
（2）電路仿真軟件(circuit simulation)：（分為數字和模擬兩大類(lèi)）。
電路仿真工具的關(guān)鍵在于對晶體管物理模型的建立，*切和實(shí)際工藝中晶體管物理特性的模型必然得到和實(shí)際電路更符合的工作波形，隨IC集成度的日益提高，線(xiàn)寬的日趨縮小，晶體管的模型也日趨復雜。任何的電路仿真都是基于一定的廠(chǎng)家庫，在這些庫文件中制造廠(chǎng)為設計者提供了相應的工藝參數；如TSMC0.18umCuCMOS工藝的相關(guān)參數高達300個(gè)之多；
       可以用于數字仿真的工具有很多，先期邏輯仿真的目的只是為了驗證功能描述是否正確。對于使用verilogHDL生成的網(wǎng)表，cadence公司的verilog-XL是基于UNIX工作站*負盛名的仿真工具；而近年隨PC工作站的出現，viewlogic的VCS和mentor公司的modelsim因其易用性而迅速崛起并成為基于廉價(jià)PC工作站的數字仿真工具的后起之秀；對于VHDL網(wǎng)表仿真，cadence公司提供LEAFROG；SYNOPSYS公司有VSS，而mentor公司基于PC的MODELSIM則愈來(lái)愈受到新手們的歡迎。
PSPICE*早產(chǎn)生于Berkley大學(xué)，經(jīng)歷數十年的發(fā)展，隨晶體管線(xiàn)寬的不斷縮小，PSPICE也引入了更多的參數和更復雜的晶體管模型。使的他在亞微米和深亞微米工藝的今天依舊是模擬電路仿真的主要工具之一。AVANTI是IC設計自動(dòng)化軟件的“英雄少年”，它的HSPICE因其在亞微米和深亞微米工藝中的出色表現而在近年得到了廣泛的應用。cadence公司的spectre也是模擬仿真軟件，但應用遠不及PSPICE和HSPICE廣泛；
對于特殊工藝設計而言，由于它們使用的不是Si基bipolar或CMOS工藝，因而也有不同的設計方法和仿真軟件；例如基于A(yíng)sGa工藝的微波器件所使用的工具，較有名的有HP的eesoft等；
（3）綜合工具(synthesistools)：用于FPGA和CPLD的綜合工具包括有cadence的synplify;synopsys公司的FPGAexpress和FPGAcompiler;mentor公司的leonardospectrum；一般而言不同的FPGA廠(chǎng)商提供了適用于自己的FPGA電路的專(zhuān)用仿真綜合工具，比如altera公司的MAXPLUS2僅僅適用它自己的MAX系列芯片；而foundation則為XILINX器件量身定做……
*早的IC綜合工具應該是cadence的buildgates;而Cadence*新版本的EnvisiaAmbit(R)則在99年在A(yíng)SICinternational公司成功用于240萬(wàn)門(mén)的設計。使用較廣泛的還有synopsys的designcompiler和behavialcompiler;基于不同的庫，邏輯綜合工具可以將設計思想轉化成對應一定工藝手段的門(mén)級電路；將初級仿真中所沒(méi)有考慮的門(mén)沿（gatesdelay）反標到生成的門(mén)級網(wǎng)表中,返回電路仿真階段進(jìn)行再仿真。*終仿真結果生成的網(wǎng)表稱(chēng)為物理網(wǎng)表。
（4）layout工具和自動(dòng)布局布線(xiàn)（auto plane &route）工具cadence的designframework是常用的基于UNIX工作站的全定制設計的布局布線(xiàn)軟件，和siliconensemble，Envisiaplace &route DSM; （cadence的版圖輸入工具Virtuoso）
（5）物理驗證（physicalvalidate）和參數提取(LVS)工具依然可以分成為ASIC和FPGA兩大類(lèi)。ASIC設計中*有名、功能*強大的是cadence的DRECULA，可以一次完成版圖從DRC（設計規則檢查），ERC（電氣特性檢查）到LVS（寄生參數提?。┑墓ば?；DIVA作為其相對較弱的軟件多提供給教學(xué)用途；AVANTI的STAR-RC也是用于物理驗證的強力工具，而hercules則是其LVS的排頭兵。如同綜合工具一樣，FPGA廠(chǎng)商的物理驗證和參數提取多采用專(zhuān)門(mén)的軟件、并和其仿真綜合工具集成在一起。ALTERA的MAXPLUS2和XILINX的FOUNDATION是這樣的典型；
（6）由于VLSI尤其是ULSI電路的預投片費用都相當的高（如TSMC0.25umCMOS工藝一次預投片的費用為100萬(wàn)美圓，而0.18umCuCMOS3.3V工藝的一次預投竟高達300萬(wàn)美圓）。因而對ASIC芯片，要求芯片設計盡量正確。*好完全消滅錯誤；解決功耗分析；生成用于芯片測試目的的特殊測試電路；因應這一要求，也產(chǎn)生了一些特殊的EDA工具，以完成諸如poweranalysis、故障覆蓋率分析、測試矢量生成等目的?，F代VLSI特別是ULSIIC的迅速發(fā)展，正是依靠EDA工具在亞微米和深亞微米技術(shù)上的進(jìn)步及其對應工藝水平的提高。應該說(shuō)沒(méi)有EDA工具就沒(méi)有IC；

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